研究院-數(shù)字邏輯設(shè)計(jì)工程師（校招）
20000-30000元
杭州
應(yīng)屆畢業(yè)生
碩士
杭州
應(yīng)屆畢業(yè)生
碩士
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
2025-08-27 00:07:39
104人關(guān)注
職位描述
該職位還未進(jìn)行加V認(rèn)證，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
崗位職責(zé)
1、負(fù)責(zé)數(shù)字邏輯架構(gòu)設(shè)計(jì)，邏輯/FPGA代碼編寫(xiě)，設(shè)計(jì)，仿真；或多模感知算法硬件加速相關(guān)技術(shù)研究和應(yīng)用；
2、負(fù)責(zé)數(shù)字邏輯/FPGA硬件調(diào)試，分析并解決開(kāi)發(fā)中的問(wèn)題，完成資源與時(shí)序優(yōu)化，滿(mǎn)足spec需要的功能與性能；
3、協(xié)同軟硬件設(shè)計(jì)人員，完成相關(guān)系統(tǒng)設(shè)計(jì)，調(diào)試，完成相關(guān)文檔編寫(xiě)。
任職要求
1、碩士及以上學(xué)歷，微電子、通信工程、電子工程、計(jì)算機(jī)等相關(guān)專(zhuān)業(yè)；
2、有數(shù)字邏輯/FPGA設(shè)計(jì)調(diào)試經(jīng)驗(yàn)；有邏輯驗(yàn)證或嵌入式開(kāi)發(fā)經(jīng)驗(yàn)；
3、熟練掌握Verilog/VHDL、systemC、C等語(yǔ)言；
4、掌握DC、VCS、Verdi、Vivado、Modelsim及相關(guān)設(shè)計(jì)的工具軟件；
5、具備良好的團(tuán)隊(duì)合作和溝通能力；
6、工作嚴(yán)謹(jǐn)，責(zé)任心強(qiáng)，心理素質(zhì)好；
7、具備圖像處理、AI算法、多模感知算法、編解碼研究及實(shí)現(xiàn)經(jīng)驗(yàn)者優(yōu)先。
截止日期：2026年08月19日
注：聯(lián)系我時(shí)，請(qǐng)說(shuō)是在杭州人才網(wǎng)上看到的。
工作地點(diǎn)
地址：杭州濱江區(qū)杭州-濱江區(qū)?？低晹?shù)字技術(shù)股份有限公司(總部西區(qū))
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職位發(fā)布者
HR
杭州海康威視數(shù)字技術(shù)股份有限公司
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電子技術(shù)·半導(dǎo)體·集成電路
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杭州市濱江區(qū)阡陌路555號(hào)
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